Low Power In-Memory Implementation of Ternary Neural Networks with Resistive RAM-Based Synapse - Université de Toulon
Communication Dans Un Congrès Année : 2020

Low Power In-Memory Implementation of Ternary Neural Networks with Resistive RAM-Based Synapse

Domaines

Micro et nanotechnologies/Microélectronique
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https://hal.science/hal-02403984

Soumis le : jeudi 6 mai 2021-09:41:11

Dernière modification le : mardi 3 septembre 2024-11:16:05

Archivage à long terme le : samedi 7 août 2021-18:23:01

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Dates et versions

hal-02403984 , version 1 (06-05-2021)

Identifiants

Citer

Axel Laborieux, Marc Bocquet, Tifenn Hirtzlin, Jacques-Olivier Klein, L Herrera Diez, et al.. Low Power In-Memory Implementation of Ternary Neural Networks with Resistive RAM-Based Synapse. 2nd IEEE International Conference on Artificial Intelligence Circuits and Systems (AICAS), 2020, Genova (virtual), Italy. ⟨10.1109/AICAS48895.2020.9073877⟩. ⟨hal-02403984⟩

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